VHDL的英文全稱為Very-High-Speed Integrated Circuit Hardware Description Language,即超高速集成電路硬件描述語言。VHDL是一種IEEE標準的硬件編程語言,兼容多種EDA軟件,具有功能強�,通用性強等特點,在電子工程領�,已成為事實上的通用硬件描述語言�
1、ENTITY(實體)
格式�
Entity 實體� IS
[類屬參數(shù)說明]
[端口說明]
End Entity�
其中端口說明格式為:
PORT(端口�1,端口名N:方向:類型�
其中方向�: IN , OUT, INOUT, BUFFER, LINKAGE
2、Arcthitecture(構造體�
格式�
Arcthitecture 構造體� of 實體� is
[定義語句] 內部信號、常�(shù)、元�、數(shù)�(jù)類型、函�(shù)等的定義
begin
[并行處理語句和block、process、function、procedure]
end 構造體名;
除了entity(實體)和architecture(構造體)外還�
另外三個可以獨立進行編譯的設計單�
Package(包集合)屬于庫結構的一個層�,存放信號定義、常�(shù)定義、數(shù)�(jù)類型、元件語�、函�(shù)定義和過程定義�
Package Body 具有獨立對端�(port)的package
configuration(配置)描述層與層之間的連接關系以及實體與構造體之間關系�
1、bit(�)� `0` 和`1`
2、bit-Vector(位矢�)� 例如:``00110``
3、Boolean � ture”和“false�
4、time 例如�1 us�100 ms�3 s
5、character 例如:‘a�、’n�、�1�� �0�
6、string 例如:“sdfsd�、”my design�
7、integer 32位例如:1�234�-2134234
8、real 范圍-1.0E38~+1.0E38 例如�1.0�2.834�3.14�0.0
9、natural 自然�(shù) � positive 正整�(shù)
10、senverity level (常和assert語句配合使用)包含有:note、warning、error、failure
以上十種類型是VHDL中的標準類型,在編程中可以直接使�。使用這十種以外的類型,需要自行定義或指明所引用的Library(�)和Package(�)集合
基本概念
1、并行處理(concurrent�
語句的執(zhí)行與書寫順序無關,并行塊內的語句時同時執(zhí)行的
2、順序處理(sequential�
語句的執(zhí)行按書寫的先后次序,從前到后順序�(zhí)�。這種方式和其他普通編程語言(如c,pascal)是一樣的
Architecture 中的語句及子模塊之間是并行處理的
子模塊block中的語句是并行處理的
子模塊process中的語句是順序處理的
子模塊subprogram中的function和procedure是順序處理的
與其他硬件描述語言相比,VHDL具有以下特點�
強大的系�(tǒng)硬件描述能力
VHDL具有多層次的設計描述功能,既可以描述系統(tǒng)級電�,又可以描述門級電�。而描述既可以采用行為描述、寄存器傳輸描述或結構描述,也可以采用三者混合的混合級描�。另�,VHDL支持慣性延遲和傳輸延遲,還可以準確地建立硬件電路模�。VHDL支持預定義的和自定義的數(shù)�(jù)類型,給硬件描述帶來較大的自由度,使設計人員能夠方便地創(chuàng)建高層次的系�(tǒng)模型�
支持廣泛、易于修�
由于VHDL已經成為IEEE標準所�(guī)范的硬件描述語言,目前大多數(shù)EDA工具幾乎都支持VHDL,這為VHDL的進一步推廣和廣泛應用奠定了基�。在硬件電路設計過程�,主要的設計文件是用VHDL編寫的源代碼,因為VHDL易讀和結構化,所以易于修改設��
功能強大、設計靈�
VHDL具有功能強大的語言結構,可以用簡潔明確的源代碼來描述復雜的邏輯控制。它具有多層次的設計描述功能,層層細�,可直接生成電路級描�。VHDL支持同步電路、異步電路和隨機電路的設�,這是其他硬件描述語言所不能比擬的。VHDL還支持各種設計方�,既支持自底向上的設�,又支持自頂向下的設�;既支持模塊化設�,又支持層次化設��
獨立于器件的設計、與工藝無關
設計人員用VHDL進行設計時,不需要首先考慮選擇完成設計的器�,就可以集中精力進行設計的優(yōu)�。當設計描述完成�,可以用多種不同的器件結構來實現(xiàn)其功��
很強的移植能�
VHDL是一種標準化的硬件描述語言,同一個設計描述可以被不同的工具所支持,使得設計描述的移植成為可能�
易于共享和復�
VHDL采用基于庫(Library)的設計方法,可以建立各種可再次利用的模�。這些模塊可以預先設計或使用以前設計中的存檔模塊,將這些模塊存放到庫�,就可以在以后的設計中進行復用,可以使設計成果在設計人員之間進行交流和共�,減少硬件電路設��
維庫電子�,電子知識,一查百��
已收錄詞�153979�